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監控用電力儀表的電磁相容設計與解決手段
釋出時間╃☁·│▩:2014-12-31   點選次數╃☁·│▩:56823次

1 前言

電力行業常用的監控儀表與傳統的電參量變送器相比│▩₪,逐步向智慧化↟◕₪、整合化↟◕₪、多功能化方向發展│▩₪,並且在電磁相容效能上也有很高的要求(EMS和EMI試驗均有相關要求)▩₪☁☁◕。設計者如何選擇適當的EMC設計方案│▩₪,對產品設計的成敗起到決定性作用▩₪☁☁◕。本文就如何進行電力監控儀表的電磁相容設計進行了綜合闡述▩₪☁☁◕。 

2 標準解讀

2.1 判定標準

結合重工業產品通用標準│▩₪,電力監控用電力儀表需要滿足的EMS↟◕₪、EMI專案及評判等級見圖1.

2.2 標準解讀

干擾通常分為持續干擾和瞬態干擾兩類▩₪☁☁◕。如廣播電臺↟◕₪、手機訊號↟◕₪、步話機等屬於持續干擾▩₪☁☁◕。由於開關切換│▩₪,電機制動等造成電網的波動│▩₪,此類干擾我們稱為瞬態干擾▩₪☁☁◕。圖1中瞬態干擾包含╃☁·│▩:浪湧SURGE│▩₪,靜電ESD│▩₪,電快速脈衝群EFT/B│▩₪,電壓暫降↟◕₪、短時中斷和電壓變化DIPS;持續干擾包含╃☁·│▩:傳導敏感度CS│▩₪,輻射敏感度RS▩₪☁☁◕。

評判等級A所述的“效能不降低”│▩₪,即干擾施加後│▩₪,硬體無損害│▩₪,干擾施加過程中無宕機↟◕₪、復位↟◕₪、資料掉幀或誤位元速率較高等問題│▩₪,好像無干擾施加到產品一樣▩₪☁☁◕。通常持續性的干擾的評判等級均採用此評判等級▩₪☁☁◕。瞬態干擾為偶然性發生│▩₪,且引起的電網干擾時間不長│▩₪,故暫時效能降低│▩₪,也就是評判等級B.

2.3 EMS試驗專案及干擾實質分析

(1)浪湧SURGE╃☁·│▩:波形1.2/50μs↟◕₪、8/20μs│▩₪,是一種脈衝寬度為幾十個μs的脈衝│▩₪,是一種傳導性干擾│▩₪,因其脈衝攜帶較強能量│▩₪,故需要對所有功能埠做相應程度的防護│▩₪,否則會引起內部電路元件的永久性硬損傷▩₪☁☁◕。

(2)靜電ESD╃☁·│▩:波形上升沿為0.7-1ns│▩₪,是一種脈衝寬度為幾十個ns的脈衝│▩₪,因其峰值電壓範圍在數千至上萬伏│▩₪,故脈衝也具有一定的能量│▩₪,須在埠做防護▩₪☁☁◕。由於其上升沿很陡│▩₪,故其攜帶的高頻諧波很豐富│▩₪,可達500MHz│▩₪,所以靜電在儀表所有裸露的金屬部件(包含端子│▩₪,螺釘等)進行接觸放電或孔縫(包含LED指示燈的開孔│▩₪,各種散熱和觀察孔)時│▩₪,或分別對水平耦合板和垂直耦合板間接放電時│▩₪,均會在放電點瞬時形成一個高頻電場│▩₪,透過空間對電路進行干擾│▩₪,這種干擾是共模干擾▩₪☁☁◕。因此│▩₪,靜電設計時應注意埠保護和空間高頻輻射場兩方面內容▩₪☁☁◕。 
(3)電快速脈衝群EFT/B╃☁·│▩:波形上升沿為5ns│▩₪,波形為數個週期脈衝串的組合│▩₪,能量很低▩₪☁☁◕。干擾的性質和靜電一樣是共模│▩₪,干擾路徑既包括傳導也包含輻射▩₪☁☁◕。

(4)傳導敏感度CS╃☁·│▩:共模干擾│▩₪,干擾頻段從150KHz到80MHz▩₪☁☁◕。在進行專案試驗時│▩₪,其干擾訊號源至儀表的線纜長度與干擾頻段(30MHz)對應的波長λ的1/4比擬│▩₪,故在施加干擾電壓的調製頻率超過30MHz時│▩₪,因趨膚效應│▩₪,干擾訊號主要以空間輻射方式出現(低於30MHz時│▩₪,主要還是以傳導方式干擾)▩₪☁☁◕。

(5)輻射敏感度RS╃☁·│▩:共模干擾│▩₪,干擾頻段從80MHz到1GHz▩₪☁☁◕。需注意│▩₪,外拖的線纜充當接收天線│▩₪,干擾為電磁場的遠場▩₪☁☁◕。

2.4 EMI試驗專案及干擾實質分析

EMI試驗包含傳導發射CE和輻射發射RE▩₪☁☁◕。CE考察的頻段為150kHz~30MHz│▩₪,RE考察的頻段為30MHz~1GHz│▩₪,通常按A類裝置要求▩₪☁☁◕。對電力儀表而言│▩₪,主要考察其內部電源(通常為開關電源)↟◕₪、晶振(包括有源晶振和無源晶振)等主要騷擾源透過天線(由外拖線纜充當)形成的傳導和輻射│▩₪,在設計時應特別注意對上述騷擾源的處理▩₪☁☁◕。

3 電磁相容設計方法

3.1 電磁相容設計的基本思路

出現EMC問題│▩₪,必須有干擾源│▩₪,耦合路徑及敏感裝置三要素│▩₪,缺少任何一個環節│▩₪,均不能構成EMC問題▩₪☁☁◕。因此│▩₪,針對EMC問題│▩₪,其設計就是針對三要素中的一個或幾個採取技術措施│▩₪,限制或消除其影響│▩₪,基本思路可分為“堵”和“疏”兩類▩₪☁☁◕。“堵”就是透過增加共模濾波器│▩₪,採用光耦等隔離或線纜套磁環等方式增加共模阻抗Z;“疏”就是透過電容形成高頻通路│▩₪,將共模干擾引入阻抗更低的地(PE)或金屬殼▩₪☁☁◕。一個EMC設計往往可以透過既“堵”又“疏”的方式│▩₪,在成本增加不大的情況下│▩₪,可獲得較好的EMC效能▩₪☁☁◕。

3.2 EMC解決手段

遮蔽↟◕₪、接地和濾波是EMC解決的三種手段▩₪☁☁◕。在下文中將詳細說明▩₪☁☁◕。

4  原理圖級設計

在確定儀表需要滿足的電磁相容專案及試驗等級後│▩₪,在原理圖設計時就有必要對相關試驗專案進行設計│▩₪,最大程度降低電磁相容風險和節省專案開發時間▩₪☁☁◕。

4.1 埠設計

儀表的埠包括電源埠及訊號埠│▩₪,在EMC測試專案中針對埠的試驗包括浪湧SURGE│▩₪,靜電ESD│▩₪,電快速脈衝群EFT/B│▩₪,傳導敏感度CS│▩₪,傳導發射CE│▩₪,電壓暫降↟◕₪、短時中斷和電壓變化DIPS▩₪☁☁◕。因此在設計中應遵循先進行浪湧防護後進行隔離/共模濾波的順序進行▩₪☁☁◕。

(1)浪湧防護設計

根據儀表埠的定義│▩₪,浪湧分為差模浪湧和共模浪湧兩種▩₪☁☁◕。如訊號埠(也包含工作電源埠)的進線和回線間為差模浪湧│▩₪,電路的進線和回線分別對地(接地端子)為共模浪湧▩₪☁☁◕。

抑制浪湧最常用的器件就是浪湧抑制器件│▩₪,如氣體防電管↟◕₪、壓敏電阻↟◕₪、TVS▩₪☁☁◕。不同的埠根據其功能│▩₪,選用不同的組合方案進行浪湧的防護▩₪☁☁◕。例如│▩₪,當儀表是三相四線輸入│▩₪,因為電壓埠為高阻輸入│▩₪,在浪湧等級要求不太高時│▩₪,一般無須採用壓敏電阻和氣體放電管▩₪☁☁◕。

(2)共模濾波器的設計

透過在埠附近設計共模濾波器│▩₪,對共模干擾進行旁路▩₪☁☁◕。濾除共模干擾也可採取設計隔離元件等增大共模阻抗的方式或透過電容接地(如果埠設計有接地端子│▩₪,應滿足相應安全要求)的方式來實現▩₪☁☁◕。

設計共模濾波器│▩₪,首先應明確共模干擾的頻段│▩₪,以便選擇合適的電感↟◕₪、電容引數▩₪☁☁◕。若需要同時抑制低↟◕₪、中↟◕₪、高頻的共模干擾│▩₪,有時可採用低頻和高頻共模濾波器串聯的方式來解決▩₪☁☁◕。

儀表電源埠往往採用開關電源│▩₪,由於開關電源是一個重要的對外干擾源│▩₪,需要在埠設計EMI濾波器▩₪☁☁◕。另外│▩₪,從EMS角度考慮│▩₪,由於隔離變壓器的輸入輸出間存在較大的分佈電容│▩₪,高頻共模干擾可以毫無衰減地從輸入耦合至輸出│▩₪,因此也需要在開關電源前設計濾波器▩₪☁☁◕。

電源埠基本濾波電路結構見圖2▩₪☁☁◕。當無PE時│▩₪,共模電容省略▩₪☁☁◕。共模扼流圈在繞制中會產生1%左右的漏感│▩₪,可直接利用來進行差模濾波│▩₪,若要加強差模濾波│▩₪,則可在扼流圈後增加差模電感設計▩₪☁☁◕。需要強調的是│▩₪,圖2所示濾波器在進行PCB布板時│▩₪,應儘量擺放在靠近於埠的位置│▩₪,且印製線走線應注意控制環路面積│▩₪,讓濾波器獲得最大的插入損耗▩₪☁☁◕。

4.2 敏感電路及器件設計

在設計中需要注意對易接收電磁干擾的電磁敏感電路和器件的設計▩₪☁☁◕。儘量採用抗擾度高的器件│▩₪,在功能滿足的情況下│▩₪,儘量降低晶振的頻率│▩₪,儘量選擇上升沿較緩的器件▩₪☁☁◕。

電容↟◕₪、電感非理想器件的寄生引數│▩₪,在高頻時將會大大影響其濾波效果│▩₪,所以對不同頻段的干擾訊號應選擇不同的濾波引數▩₪☁☁◕。以電容為例│▩₪,其頻率阻抗曲線見圖3.這裡需要強調的是│▩₪,該類器件的引線過長時│▩₪,其高頻下寄生引數會降低自身的諧振頻率│▩₪,建議儘量採用貼片器件▩₪☁☁◕。一個常用的做法是選擇引數相差100倍的電容進行並聯│▩₪,以保證在其較寬的頻段範圍內始終保持電容特性▩₪☁☁◕。

數字晶片均應做去耦設計│▩₪,特別是攜帶豐富高次諧波的數字電源引腳│▩₪,通常用0.1μF電容與1nF電容並聯▩₪☁☁◕。對於數字晶片中因結構↟◕₪、傳輸路徑等客觀因素影響的關鍵訊號均應做去耦設計│▩₪,去耦時應注意不要影響訊號的正常傳輸▩₪☁☁◕。

對於特別敏感的電路單元│▩₪,在成本允許和結構設計時應充分考慮│▩₪,針對輻射試驗專案(RS和RE)遮蔽材料選擇鋁或銅等金屬│▩₪,設計時為保證足夠的遮蔽效能應保證低接地阻抗│▩₪,在此不作詳細說明▩₪☁☁◕。

5 結構級↟◕₪、PCB級設計

結構上需要考慮靜電放電↟◕₪、射頻電磁場輻射↟◕₪、輻射發射三項EMC試驗專案│▩₪,下面主要以因結構限制│▩₪,在PCB設計中常出現的一些問題進行分析▩₪☁☁◕。

常見問題一│▩₪,儀表因自身結構緊湊│▩₪,內部常由幾塊PCB構成│▩₪,PCB之間透過插針↟◕₪、互聯排線等連線│▩₪,如何進行EMI防護│₪?

這些都是EMC最為脆弱的環節│▩₪,當連線長度與干擾頻率的波長可比擬時│▩₪,既容易接收到外界的干擾│▩₪,也容易將內部干擾帶出產品│▩₪,引起EMI超標▩₪☁☁◕。

設計時可從以下三方面著手解決╃☁·│▩:①對插針中傳遞的訊號進行濾波;②儘量減少插針↟◕₪、互聯排線的長度(從工藝角度可將其捆紮);③增加地針數目│▩₪,最好採用“地——訊號1——地——訊號2——地——訊號3——地”方式│▩₪,減少訊號的迴路面積│▩₪,降低不同PCB之間的Zgnd.

常見問題二│▩₪,針對液晶顯示屏│▩₪,LED指示燈│▩₪,孔縫等如何進行靜電ESD防護│₪?

在設計中建議對液晶顯示屏採取透明材料絕緣處理│▩₪,或增大與內部電路的放電距離▩₪☁☁◕。

PCB佈線時應注意╃☁·│▩:①濾波器設計時不要讓輸入輸出分開│▩₪,避免耦合│▩₪,最好採用“一”或“L”型;②對關鍵晶片的敏感訊號去耦時│▩₪,去耦電容應緊靠其管腳│▩₪,以減小回路面積;③敏感訊號不能從晶振底部穿越│▩₪,也不能離靠近儀表埠│▩₪,長距離傳輸時│▩₪,應注意採用包地方式;④儘量縮短關鍵訊號的傳遞路徑距離│▩₪,採用伴地設計時│▩₪,注意增加地過孔的數目;⑤注意不要讓敷地存在地割裂情況;⑥透過增加距離來降低相訊號通道間的空間耦合;⑦透過正交來解決PCB頂層和底層訊號的相互影響;⑧模擬地和數字地在一點處連線│▩₪,A/D通常視作模擬器件▩₪☁☁◕。

常見問題三│▩₪,如何“接地”│₪?一個產品只有一個接地點▩₪☁☁◕。因而│▩₪,對於接地點位置的選擇十分重要│▩₪,設計時應保證接地點位於干擾訊號注入埠且具有低的接地阻抗│▩₪,透過電容可對共模干擾訊號能進行旁路▩₪☁☁◕。若儀表埠設計時預留了一個接地端子│▩₪,可以是前端三相四線輸入電壓(La↟◕₪、Lb↟◕₪、Lc↟◕₪、N)的保護地PE│▩₪,也可以是其交流工作電源(L↟◕₪、N)的保護地PE或者還有可能是RS485通訊(A↟◕₪、B)的保護地PE/遮蔽地FG.

地設計時還應保證這個地是乾淨的地│▩₪,即EMC中所述的“靜地”▩₪☁☁◕。當地不乾淨時│▩₪,共模干擾訊號可能會從地反竄流入訊號造成地汙染│▩₪,所以結構設計和PCB設計時│▩₪,常用做法是在埠預留一塊銅箔│▩₪,讓其與內部其它訊號分割開來│▩₪,且留有一定的距離(安全要求考慮)▩₪☁☁◕。

6 結束語

電子產品在進行功能設計時│▩₪,就需要進行電磁相容方面的考慮│▩₪,電力監控用電力儀表也不例外▩₪☁☁◕。EMC設計需要從原理圖↟◕₪、PCB和結構等方面進行綜合考慮│▩₪,並根據實際情況進行相互調整│▩₪,這樣才能最大程度的降低EMC風險│▩₪,減少EMC整改成本│▩₪,最終滿足相關標準的要求▩₪☁☁◕。

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